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Verilog基本知识(下)  
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【作者】 夏宇闻;
【作者单位】 北京航空航天大学;
【文献出处】 电子产品世界 , Electronic & Computer Design World, 编辑部邮箱 2002年 20期  
期刊荣誉:ASPT来源刊  中国期刊方阵  CJFD收录刊
【分类号】 TN791
【正文快照】 Verilog HDL设计复杂数字电路的优势传统电路原理图输入法几十年前,当时所做的复杂数字逻辑电路及系统的设计规模比较小也比较简单,其中所用到的FPGA或ASIC设计工作往往只能采用厂家提供的专用电路图输入工具来进行。为了满足设计性能指标,工程师往往需要花好几天或更长的时

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