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一种基于FPGA的时钟跟踪环路的设计与实现

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【摘要】 提出了一种基于FPGA的时钟跟踪环路的设计方案,该方案简化了时钟跟踪环路的结构,降低了时钟调整电路的复杂度。实际电路测试结果表明,该方案能够使接收机时钟快速准确地跟踪发射机时钟的变化,且时钟抖动小、稳准度高、工作稳定可靠。

【关键词】 扩频通信抖动漂移数字延迟锁定环FPGA
  • 【文献出处】 电子技术应用 ,Application of Electronic Technique , 编辑部邮箱 ,2006年01期
  • 【分类号】TN79
  • 【被引频次】1
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