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片上多核处理器Cache一致性协议优化研究综述  
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【英文篇名】 Survey on Cache Coherence Protocol and Performance Optimization for Chip Multi-Processor
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【作者】 胡森森; 计卫星; 王一拙; 陈旭; 付文飞; 石峰;
【英文作者】 HU Sen-Sen; JI Wei-Xing; WANG Yi-Zhuo; CHEN Xu; FU Wen-Fei; SHI Feng; High Performance Embedded Computation Laboatory; School of Computer Science and Technology; Beijing Institute of Technology;
【作者单位】 北京理工大学计算机学院嵌入式高性能计算实验室;
【文献出处】 软件学报 , Journal of Software, 编辑部邮箱 2017年 04期  
期刊荣誉:中文核心期刊要目总览  ASPT来源刊  中国期刊方阵  CJFD收录刊
【中文关键词】 片上多核处理器; 缓存一致性协议; 性能优化;
【英文关键词】 chip multi-processor; cache coherence protocol; performance optimization;
【摘要】 现代晶体管技术在单芯片上集成多个处理器已经成为现实.近年来,随着多核处理器集成核数的不断增加,高速缓存的一致性问题凸显出来,已成为多核处理器的性能瓶颈之一,亟待解决.介绍了片上多核处理器一致性问题的由来.总结了多核时代高速缓存一致性协议设计的关键问题,综述了近年来学术界对一致性的研究.从程序访存行为模式、目录组织结构、一致性粒度、一致性协议流量、目录协议的可扩展性等方面,阐述了近年来缓存一致性协议性能优化的方向.对目前片上多核处理器缓存一致性协议设计中存在的问题进行了讨论,并指出了未来进一步研究的方向.
【英文摘要】 Modern-Day transistor technique enables the industry to integrate many cores on a single chip. As an increasing number of cores being integrated on a single chip, cache coherence has become an intractable issue as well as a bottleneck of performance. In this paper, the origin of cache coherence is carefully described. Further, the paper summarizes the key issue of cache coherence and reviews the study in this field a decade after entering the mulit-core era. From aspects of memory access, directory organiza...
【基金】 国家自然科学基金(61300010,61300011); 中国科学院计算技术研究所计算机体系结构国家重点实验室开放课题(CARCH201404)~~
【更新日期】 2017-05-03
【分类号】 TP332
【正文快照】 科学家预计:在未来的十几年中,摩尔定律仍然将统治着半导体技术的发展.然而在最近10年的发展中,依赖提高处理器频率的传统方法不再有效,单核处理器的性能提升基本走到了尽头[1].2001年,IBM Power4[2]的推 出,标志着世界上第一个商用多核处理器(multi-core processor)正式诞生.

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