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一种消除反馈延迟的全数字锁相环  
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【英文篇名】 An All-Digital Phase-Locked Loop with Compensating Feedback Unit Delay
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【作者】 孙高阳; 刘亚静; 李秉格; 朱玉龙; 范瑜;
【英文作者】 Sun Gaoyang; Liu Yajing; Li Bingge; Zhu Yulong; Fan Yu; School of Electrical Engineering Beijing Jiaotong University;
【作者单位】 北京交通大学电气工程学院;
【文献出处】 电工技术学报 , Transactions of China Electrotechnical Society, 编辑部邮箱 2017年 20期  
期刊荣誉:中文核心期刊要目总览  ASPT来源刊  CJFD收录刊
【中文关键词】 锁相环; 反馈滞后一拍; 滞后补偿; 动态性能;
【英文关键词】 Phase-locked loop(PLL); feedback unit delay; delay compensation; dynamic performance;
【摘要】 针对传统数字锁相环存在的反馈滞后造成系统动、静态性能退化的问题,提出一种消除反馈滞后一拍的方法,以无反馈滞后理想数字锁相环为参考模型,利用数字锁相环当前输出与上一时刻输出,计算得到与理想数字锁相环一致的结果,从而消除反馈滞后一拍。所提出的锁相环仅以两个乘法器的额外开销即可大幅增强锁相环的稳定性,并且使在s域内设计的性能指标能够在z域内严格实现,克服了传统数字锁相环性能退化的问题。仿真和实验结果表明,所提改进的数字锁相环阶跃响应和频率特性均与理想数字锁相环一致,显著提高了锁相环性能,所提新算法增加的计算量较少,具有较大的实际应用价值。
【英文摘要】 The feedback unit delay in conventional digital PLL causes adverse effects to system steady-state and dynamic performance. Therefore, referred to ideal digital PLL without feedback delay, an improved digital PLL was proposed utilizing the present and previous outputs of PLL to calculate the ideal output. The proposed novel PLL with merely two additional multipliers can improve the system stability dramatically. Moreover, the performance indexes designed in s domain can be implemented strictly in z domain, t...
【基金】 国家自然科学基金(51407005); 高等学校博士学科点专项科研基金(20130009120032); 中央高校基本科研业务费(2016JBM056)资助项目
【更新日期】 2017-11-03
【分类号】 TN911.8
【正文快照】 0引言正交锁相环(Phase-Locked Loop,PLL)已广泛用于电网电量测量[1-3]、电机位置、速度检测与估计[4-6]等场合。目前主要的研究热点集中在电网电压三相不对称或畸变时,如何准确快速地获取相位、频率信息,主要研究思路包括在主流同步旋转坐标系锁相环基础上的结构改进以及新算?

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