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深亚微米并行CRC32编码芯片的设计和实现  
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【英文篇名】 Design and implementation of deep sub-micron parallel CRC32 coding chip
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【作者】 郭宝增; 吴鹏飞;
【英文作者】 GUO Baozeng; WU Pengfei; College of Electronic and Informational Engineering; Hebei University;
【作者单位】 河北大学电子信息工程学院;
【文献出处】 河北大学学报(自然科学版) , Journal of Hebei University(Natural Science Edition), 编辑部邮箱 2014年 01期  
期刊荣誉:中文核心期刊要目总览  ASPT来源刊  中国期刊方阵  CJFD收录刊
【中文关键词】 CRC32; 并行; FPGA; Design Compiler; Soc Encounter;
【英文关键词】 CRC32; Parallel; FPGA; Design Compiler; Soc Encounter;
【摘要】 在分析CRC编码算法的基础上,从传统的串行编码算法着手,推导出适合高速通信的并行算法,通过FPGA(现场可编程门阵列)验证确保算法代码的逻辑功能正确;采用中芯国际simc18(180nm工艺库)实现了并行CRC32编码芯片的设计.该设计具有编码速度快、占用资源少、低功耗、易于量产等优点.
【英文摘要】 This paper analyzes the theory of CRC coding algorithm,calculates parallel algorithm which applies to high-speed communication,according to the traditional serial coding algorithm,ensures the logic function correctly by FPGA verification;achieves parallel CRC32coding chip design with simc18(180nm technology library).The advantages of the design is faster coding,less resource,low-power,easier to large-scale production and so on.
【基金】 河北省自然科学基金资助项目(F2009000226); 河北省教育厅科学研究计划项目(2008308)
【更新日期】 2014-04-29
【分类号】 TN402
【正文快照】 CRC的全称是循环冗余校验(cyclic redundancy check),是一种非常著名的检错手段,在通信和数据存储领域得到广泛应用.其特点是检错能力极强,开销小,易于编码器及检测电路实现.从检错能力来看,其不能发现的错误的几率在0.004 7%以下.著名的通讯协议X.25的FCS(帧检错序列)采用的是

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