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总线式并行计算构架及数据精密同步机制设计  
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【英文篇名】 Design of bus-type parallel computing architecture and data precision synchronization mechanism
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【作者】 周柔刚; 程鑫; 周云飞; 刘广斗;
【英文作者】 Zhou Rougang; Chen Xin; Zhou Yunfei; Liu Guangdou; State Key Lab of Digital Manufacturing Equipment and Technology; Huazhong University of Science and Technology; The Department of Mechanical and Electrical Engineering; Wuhan University of Technology;
【作者单位】 华中科技大学数字制造与装备国家重点实验室; 武汉理工大学机电工程系;
【文献出处】 华中科技大学学报(自然科学版) , Journal of Huazhong University of Science and Technology(Natural Science Edition), 编辑部邮箱 2013年 12期  
期刊荣誉：中文核心期刊要目总览  ASPT来源刊  中国期刊方阵  CJFD收录刊
【中文关键词】 自定义总线; 内存调度; VME总线; 在线重构机制; 共享内存;
【英文关键词】 self defined data bus; scheduling memory; versa module euro card bus; on-line reorganization; shared memory;
【摘要】 为满足光刻机控制系统对超过20个处理器同步并行计算的需求,提出了一种多处理器同步控制系统架构.该架构采用一种分布式处理器的数据轮询调度机制,通过基于无握手传输协议的自定义数据总线,实现多块板卡处理器内数据高速低延时共享.为解决多处理器计算同步问题,系统采用时钟校准机制,使得挂接于总线的运动控制卡能够在每个伺服周期进行时钟校准,保证了系统的精密同步运行.在线重构设计实现了系统通过上位机对各个处理器间所需交互数据的灵活在线修改.测试结果表明:系统总线数据交互能力能够达到160m/s,板卡间信号延时低于10ns,能够满足光刻机控制系统的需求.
【英文摘要】 To solve synchronous parallel computing problem of lithography control systems with more than 20processors,a multi-processors synchronization control system architecture was described. Distributed processors poll scheduling mechanism was adopted in the architecture,based on no handshake transports and self-design data bus,and the data was shared within the processors in high speed and low delay.To solve the problem of multi-processors computing synchronization in the system,a clock calibration mechanism was...
【基金】 国家重大科技专项资助项目(2009ZX02308)
【更新日期】 2014-04-17
【分类号】 TP273
【正文快照】 双工件台光刻机系统须要同时对测量台、曝光台及掩膜台中40多个轴运动进行纳米级精度控制[1-5],苛刻的控制精度及10ns内运算同步性需要高性能的控制系统完成.由于单处理器频率和计算能力的限制,多处理器同步并行处理系统被采用.在目前同步并行计算系统中,MPI[6](message passin

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