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一种基于累积分布函数的抖动测量方法  
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【英文篇名】 A New On-Chip Jitter Measurement Method Based on Cumulative Distribution Function
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【作者】 郭健; 冯建华; 叶红飞;
【英文作者】 GUO Jian1; 2; FENG Jianhua1; YE Hongfei1 1.Department of Microelectronics; Peking University; Beijing 100871; 2.Key Laboratory of Integrated Microsystem Science Engineering and Applications; Shenzhen Graduate School of Peking University; Shenzhen 518055;
【作者单位】 北京大学微电子学系; 北京大学深圳研究生院集成微系统科学工程与应用重点实验室;
【文献出处】 北京大学学报(自然科学版) , Acta Scientiarum Naturalium Universitatis Pekinensis, 编辑部邮箱 2012年 03期  
期刊荣誉:中文核心期刊要目总览  ASPT来源刊  中国期刊方阵  CJFD收录刊
【中文关键词】 时钟抖动; 内建抖动测试; 时间数字转换器;
【英文关键词】 timing jitter; built-in jitter measurement(BIJM); time-to-digital(TDC);
【摘要】 提出一种基于累积分布函数(CDF)的抖动测量方法,以解决在测试高频时钟信号抖动中遇到的延迟器件不匹配、占用芯片面积过大和受高频振荡信号限制等问题。采用65 nm CMOS工艺完成了测试电路的设计和功能模拟,模拟结果表明该电路可用于测量2.5 GHz时钟抖动值,抖动测量精度达到1 ps。
【英文摘要】 The authors present a new on-chip jitter measurement method based on cumulative distribution function(CDF) to solve the problem of the mismatch of the delay line,taking up too much chip area and limited by high frequency oscillator signal,which are encountered in measuring multi-GHz clock jitter.The complete circuit is designed and implemented based on the 65 nm CMOS process.The simulation results show that the circuit is able to operate at 2.5 GHz and achieves a timing resolution up to 1 ps.
【基金】 国家自然科学基金(90207018,60576030); 国家科技重大专项(2009ZX02027)资助
【更新日期】 2012-05-29
【分类号】 TN407
【正文快照】 随着集成电路特征尺寸不断减小,工作频率越来越高。当数据和时钟速度进入GHz量级时,抖动已成为制约系统性能的重要因素[1]。在高速系统中,微小的时钟或数据抖动对整个系统都会产生巨大的影响,如抖动会造成电路时序错误,在数据传输过程中也会导致误码率升高[2]。因此,只有全面有

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