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一种位同步时钟提取方案及实现
【摘要】 提出了一种数字通信中位同步时钟信号快速提取的方案。本方案比通常用的锁相环法具有同步快、实现简单等特点。据此方案设计了位同步时钟提取电路,并用CPLD予以实现,同时给出了该电路的仿真实验结果。
- 【文献出处】 无线电工程 ,Radio Engineering of China , 编辑部邮箱 ,2003年10期
- 【分类号】TN915
- 【被引频次】51
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【摘要】 提出了一种数字通信中位同步时钟信号快速提取的方案。本方案比通常用的锁相环法具有同步快、实现简单等特点。据此方案设计了位同步时钟提取电路,并用CPLD予以实现,同时给出了该电路的仿真实验结果。